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基于臺積電 28 納米低功耗 (28LP) 工藝技術(shù)— 5CSEBA5U19I7N SoC FPGA

 介紹:

5CSEBA5U19I7N是一款基于臺積電 28 納米低功耗 (28LP) 工藝技術(shù)的Cyclone® V SE SoC FPGA產(chǎn)品。它提供一個 8 輸入自適應(yīng)邏輯模塊 (ALM) 和精度可調(diào)數(shù)字信號處理 (DSP) 模塊,可支持高達(dá) 13.59 兆位 (Mb) 的嵌入式內(nèi)存。

 

該產(chǎn)品在單個 Cyclone® V 片上系統(tǒng) (SoC) 中緊密集成了雙核 ARM® Cortex®-A9 MPCore 處理器、硬核 IP 和 FPGA。它支持超過 128 Gbps 的峰值帶寬,在處理器和 FPGA 架構(gòu)之間集成了數(shù)據(jù)一致性。

 

制造商 Intel
型號 5CSEBA5U19I7N
封裝 UBGA-484

 

主要功能:

• 嵌入式內(nèi)存塊:

M10K:具有軟糾錯碼 (ECC) 的 10 千位 (Kb) 內(nèi)存塊。

內(nèi)存邏輯陣列塊 (MLAB):640 位分布式 LUTRAM,最多可將 25% 的 ALM 用作 MLAB 內(nèi)存。

• 通用 I/O:

875 兆位每秒 (Mbps) 的低壓差分信號 (LVDS) 接收器和 840 Mbps 的 LVDS 發(fā)射器。

400 MHz/800 Mbps 外部內(nèi)存接口。

片上終端 (OCT)。

支持 3.3 V 電壓,驅(qū)動強(qiáng)度高達(dá) 16 mA。

• 外部內(nèi)存接口:

在 Cyclone® V SoC 設(shè)備上,HPS 中的額外硬核內(nèi)存控制器支持 DDR3、DDR2 和 LPDDR2 SDRAM 設(shè)備。

• 硬處理器系統(tǒng) (HPS):

HPS 由雙核 Arm* Cortex* -A9 MPCore* 處理器、一組豐富的外設(shè)和共享多端口 SDRAM 內(nèi)存控制器組成。

 

應(yīng)用:

• 下一代驅(qū)動器的能效

• IP 閉路電視監(jiān)控

• 高清 (HD) IP 攝像頭

 

Cyclone® V SE SoC FPGA:

5CSEBA5U19C8N

5CSEBA5U23A7N

5CSEBA5U23C6N

5CSEBA5U23C7N

5CSEBA5U23C8N

5CSEBA5U19I7N

5CSEBA5U19C6N

5CSEBA5U19C7N

5CSEBA6U19A7N

5CSEBA6U19C6N

5CSEBA6U19C7N

5CSEBA6U19C8N

5CSEBA6U23A7N

5CSEBA6U23C7N

5CSEBA6U23C8N

5CSEMA5F31C6N

5CSEMA5F31C7N

5CSEMA5F31C8N

5CSEMA5U23A7N

5CSEMA5U23C6N

5CSEMA5U23C7N

5CSEMA5U23C8N

5CSEMA5U23I7N

5CSEMA6U23A7N

5CSEMA6U23C6N

5CSEMA6U23C8N

5CSEMA6U23I7N

Cyclone® V SE FPGA 集成了 ARM® Cortex®-A9 MPCore 處理器系統(tǒng),針對 614 Mbps 至 3.125 Gbps 收發(fā)器應(yīng)用,優(yōu)化實(shí)現(xiàn)了低系統(tǒng)成本和功耗。

 

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點(diǎn)擊數(shù):0 | 更新時間:2024-10-19 09:50:39
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